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DP1332E收发器SoC芯片概述及特性

DP1332E是一款高度集成的收发器SoC芯片,其基于80C51微控制器内核,可实现13.56MHz的非接触式通信,支持各种卡和读/写操作模式。

DP1332E芯片特性

PIN对PIN替代PN532,软硬件兼容

工作在 13.56MHz 频段

读写器模式,支持ISO/IEC14443A/MIFARE机制

读写器模式,支持FeliCa机制

读写器模式,支持ISO/IEC14443B机制

卡操作模式,支持ISO14443A/MIFARE 机制

卡操作模式,FeliCa机制

支持NFCIP-1模式,ISO/IEC18092,ECM340点对点

带40kB ROM和1kB RAM的80C51微控制器内核

高度集成的模拟电路,解调和译码响应

输出缓冲驱动器通过最少量的外部无源器件连接天线

集成了RF场检测器

集成了数据模式检测器

支持ISO/IEC14443A/MIFARE

只在读写器模式中支持ISO/IEC14443B

在读写器模式中典型工作距离超过50mm,具体距离由天线尺寸、调谐和电源决定

在NFCIP-1模式下工作距离高达50mm,具体视天线的尺寸、调谐以及电源而定

在卡操作模式中典型工作距离约为100mm,具体距离由天线尺寸、调谐和外部场强度决定

在读写器模式中,支持MifareClassic加密,可支持212kbit/s和424kbit/s两种更高数据传输速率

FeliCa模式下,支持106kbit/s、212kbit/s和424kbit/s的通信波特率

集成了NFCIP-1的RF接口,传输速率高达424kbit/s

支持主机接口

-SPI接口

I2C接口

-串行UART

灵活的中断模式

低功耗模式一硬件掉电模式一软件掉电模式

当器件处于掉电模式时能够通过I2C、HSU和SPI接口自动唤醒

可编程定时器

石英晶体振荡器

2.7V~5.5V的电源

6*6mm 封装HVQFN40

唤醒DP1332E条件

将芯片唤醒必须满足以下3个条件

1)PVDD引脚拉高

2)I2C模式下发送地址48h,SPI模式下将NSS拉低,串口模式下的其实数据头必须为0x55,0x55,0x00,0x00,0x00,0x00,0x00,0x00,0x00,0x00,0x00,0x00,0x00,0x00,0x00,0x00,0xFF,0x03,0xFD,0xD4,0x14,0x01,0x17,0x00

3)主机必须发送命令140200(虚拟模式)或者1401(正常模式)

审核编辑:汤梓红

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